신규 PAX_LDPC v1.0 출시 — TLC/QLC SSD용 FPGA 검증 QC-LDPC 자세히 보기 →
PaxQubit

NAND에서 큐비트까지.

PaxQubit · (주)평정기술 — 반도체 IP 전문기업. BCH-ECC · LDPC · 보안 · DSP · 스테레오 FM 튜너 · 커스텀 IP

실리콘 설계 엔지니어가 만든, 표준을 준수하는 오류정정·암호화 IP — FPGA와 ASIC 모두 대응합니다.

IP 카탈로그

바로 라이선스 가능한 실리콘급 IP 코어

베스트셀러
오류정정

156-bit BCH ECC IP 코어

정정강도와 섹터 크기를 고르면 drop-in Verilog RTL이 나옵니다. 섹터당 최대 156비트 오류 정정, t=8부터 구성 가능.

BCH · t=8…156 · 512 B…1 MB · 8-bit/cycle
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추천
오류정정

QC-LDPC ECC IP 코어 (PAX_LDPC)

inner LDPC + outer BCH + CRC32로 UBER < 1e-15 목표. 단일 rate-compatible 아키텍처가 파라미터만으로 TLC·QLC를 모두 커버.

QC-LDPC · Z=256 · rate 0.897 / 0.844 / 0.802 · 2-tier decoder
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출시 예정
보안·암호

AES-256 암호화 IP 코어

저장 데이터(XTS)·전송 데이터(GCM)를 위한 표준 준수 AES-256. 로드맵 — 얼리액세스 문의.

AES-256 · XTS / GCM / CBC / CTR · FIPS-197
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추천
보안·암호

PBKDF2-HMAC 키 유도 IP 코어

RFC 8018 PBKDF2-HMAC를 하드웨어로. midstate 캐시 SHA-256 코어, AXI4-Lite, 튜너블 work-factor — AES-XTS와 결합해 풀 보안 스토리지 데이터패스 구성.

PBKDF2 · HMAC-SHA-256/512 · AXI4-Lite · RFC 8018
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신규추천
신호처리

스테레오 FM 튜너 IP 코어 (DDC 수신기)

S/N 105 dB급 실측. NCO·믹서 DDC → CIC/FIR 데시메이션 → CORDIC FM 복조 → 19 kHz 파일럿 스테레오 디코드 → 24-bit I2S / S-PDIF / AES-EBU, 적응형 멀티패스 캔슬러 내장.

S/N 105 dB-class · DDC + CORDIC · 24-bit I2S / S-PDIF / AES-EBU
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신규
신호처리

ADSP-2181 호환 DSP 코어 IP

24-bit ADSP-21xx 정식 명령어 인코딩과 사이클 정확 동작, SPORT · 타이머 · 오토버퍼 · BDMA · IDMA 주변장치 포함. 3종 시뮬레이터와 합성으로 검증.

ADSP-21xx ISA · cycle-accurate · Fmax 69.91 MHz (Arria II GX)
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연구
신호처리

DSP56001 호환 DSP 코어 IP

56-bit 누산기와 X/Y/P 3버스, 모듈로·비트리버스 어드레싱을 갖춘 24-bit 데이터패스. 명령어 인코딩을 공식 어셈블러 리스팅과 98~99 % 대조 완료했고, 코어 데이터패스는 실제 DSP 커널을 실행합니다.

DSP56001 ISA · 24-bit · 56-bit accumulators · in development
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신규
신호처리

TMS320C54x 호환 DSP 코어 IP

프로그램 버스 1개와 데이터 버스 3개의 modified Harvard 구조, 6단 파이프라인, 40-bit 누산기 2개를 갖춘 40-bit ALU, 단일 사이클 MAC을 위한 17x17 곱셈기와 전용 40-bit 가산기. Viterbi용 CSSU, 지수 인코더, C54x 주변장치 세트를 포함합니다.

TMS320C54x ISA · 6-stage · 17x17 MAC · 50 MIPS (0.35 um ref.)
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신규추천
스토리지 인터페이스

UFS 호스트 컨트롤러 IP 코어 (AXI4)

SoC에서 UFS 디바이스를 구동합니다. AXI4로 디스크립터 페치와 데이터 DMA, APB3로 UFSHCI 레지스터 모델, 그리고 SerDes 접속용 PHY 어댑터까지의 UTP·UniPro·데이터링크 스택 전체. 기능 회귀 15종이 3개 시뮬레이터에서 통과하며 문장 커버리지 94 %입니다.

UFSHCI 3.0 · AXI4 master + APB3 · HS-G1 1-lane · 32 slots
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신규추천
프로세서

VR-RISC-V 코어 IP (RV32IMAC)

RV32IMAC + Zicsr를 순수 Verilog-2001로. 5단 인-오더 파이프라인, 명령어·데이터를 각각 1사이클에 공급하는 128 KB True Dual-Port TCM, 주변장치용 AXI4-Lite 마스터 1개, 그리고 빌드 시점에 개별 토글되는 M · A · C 확장.

RV32IMAC+Zicsr · 5-stage valid-ready · 128 KB TCM · AXI4-Lite
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신규연구
오류정정

qLDPC 디코더 IP 코어

고전 LDPC 디코딩 역량을 양자 오류정정으로 — qLDPC 코드용 실시간 신드롬 디코더. 얼리액세스·연구 협력.

qLDPC · BP / BP+OSD · real-time syndrome decode
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스토리지 시큐리티 스택

키 언랩부터 NAND 보호까지, 단일 데이터패스

PaxQubit는 보안 스토리지 데이터패스의 모든 블록을 제공합니다 — 멀티벤더 통합이 필요 없습니다.

01

PBKDF2

패스프레이즈에서 미디어 키를 언랩

02

AES-256-XTS

섹터 단위 데이터 암호화

03

BCH / QC-LDPC

NAND 비트 오류 정정

왜 PaxQubit인가

보안 인증부터 시스템 수명까지

보안 인증

무차별 대입에 강한 키 수립

PBKDF2-HMAC 키 스트레칭(솔트 + 튜너블 반복) — 사용자에겐 약 0.1초, 공격자에겐 수년. RFC 8018 / NIST SP 800-132 준수.

풀 데이터패스

단일 벤더 보안 스토리지

PBKDF2 → AES-XTS → BCH/LDPC, eMMC RPMB까지 SHA 코어 공유 — 멀티벤더 통합 없이 면적·검증 비용 절감.

시스템 수명

NAND 수명·신뢰성 극대화

소프트결정 QC-LDPC와 고강도 BCH가 TLC/QLC NAND의 내구·리텐션 마진을 넓혀 드라이브 가동 수명을 늘립니다.

표준 준수

실리콘급 · 표준 정합

FIPS · NIST · IEEE 1619 · 3GPP · JEDEC에 정합된 FPGA/ASIC 대응 RTL.

표준 및 컴플라이언스

FIPS 197NIST SP 800-38IEEE 1619PKCS#5 / RFC 80183GPP NRJEDEC NAND

컨트롤러나 SoC에 들어갈 코어가 필요하신가요?

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